음향:audio_equipment:dsp
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음향:audio_equipment:dsp [2025/05/07] – ↷ 링크가 이동 작업으로 인해 적응했습니다 정승환 | 음향:audio_equipment:dsp [2025/08/13] (현재) – [DSP LoadLock] 정승환 | ||
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DSP 칩을 주로 제작하는 회사로는 Texas instrument, Motorola, Analog device 와 같은 회사들이 있다. | DSP 칩을 주로 제작하는 회사로는 Texas instrument, Motorola, Analog device 와 같은 회사들이 있다. | ||
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Analog Device 사의 SHARC 칩을 많이 사용한다. | Analog Device 사의 SHARC 칩을 많이 사용한다. | ||
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- | UAD 2, Avid HDX DSP((32bit 부동소수 DSP))</WRAP> | + | |
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- | UAD1((UAD1 은 1개의 24bit DSP 칩만 사용했다.))</WRAP> | + | |
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- | 주요 DSP 엔진에 따른 심도 연산 스펙 \\ | + | |
- | 참고로 여기 나오는 DSP 제품 중에, 24bit DSP를 가진 UAD 나 TC Powercore 등은 다이내믹 계열 플러그인의 음질에 대하여 논란이 많았다.((이 시절엔 오히려 외장 DSP를 쓰는 플러그인이 CPU 기반 Native 플러그인보다 음질이 떨어지는 것에 대해 말이 많았을 정도.))\\ | + | |
+ | ====주요 DSP 엔진에 따른 심도 연산 스펙==== | ||
+ | 참고로 여기 나오는 DSP 제품 중에, 24bit DSP를 가진 UAD 나 TC Powercore 등은 다이내믹 계열 플러그인의 음질에 대하여 논란이 많았다.((이 시절엔 오히려 외장 DSP를 쓰는 플러그인이 CPU 기반 Native 플러그인보다 음질이 떨어지는 것에 대해 말이 많았을 정도.)) | ||
* TDM : 48bit 정수 배정밀도 | * TDM : 48bit 정수 배정밀도 | ||
* VST : 32bit 부동소수(최근엔 내부적으로 64bit 부동소수 배정밀도 가능), | * VST : 32bit 부동소수(최근엔 내부적으로 64bit 부동소수 배정밀도 가능), | ||
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DSP 보드 구성 방법 중 하나인, DSP 칩을 여러개 사용해서 단일 CPU 와 같은 동급의 성능을 내려면, 여러 개의 DSP 칩을 1개의 DSP 칩 처럼 동작하게 만들어 주는 병렬 프로세서인 FPGA 칩이 필요한데, | DSP 보드 구성 방법 중 하나인, DSP 칩을 여러개 사용해서 단일 CPU 와 같은 동급의 성능을 내려면, 여러 개의 DSP 칩을 1개의 DSP 칩 처럼 동작하게 만들어 주는 병렬 프로세서인 FPGA 칩이 필요한데, | ||
- | <WRAP centeralign box> | + | <imgcaption image4 center|FPGA 칩 1개 + DSP 칩 8개(UAD octacore의 연산 능력은 팬티엄이나 I3 CPU 와 비슷한 수준이다.) 어떤 면에서는 가성비가 없다고 볼 수 있다.(가격이 컴퓨터 보다 비쌈.) |
- | FPGA 칩 1개 + DSP 칩 8개((UAD octacore의 연산 능력은 팬티엄이나 I3 CPU 와 비슷한 수준이다)). 어떤 면에서는 가성비가 없다고 볼 수 있다.((가격이 컴퓨터 보다 비쌈.))</WRAP> | + | > |
하지만 CPU를 DSP로 쓰는 장비들의 경우 발열, 그리고 발열에 의한 냉각 용 팬 소음이 아직 해결해야 할 과제이다. | 하지만 CPU를 DSP로 쓰는 장비들의 경우 발열, 그리고 발열에 의한 냉각 용 팬 소음이 아직 해결해야 할 과제이다. | ||
[[정승환_컬럼: | [[정승환_컬럼: | ||
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=====CPU 기반의 DSP 제품들===== | =====CPU 기반의 DSP 제품들===== | ||
* [[instrument_wiki: | * [[instrument_wiki: | ||
- | * [[instrument_wiki: | + | * TC SYSTEM 6000 |
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참고할만한 글 | 참고할만한 글 | ||
- | [[https:// | + | * [[https:// |
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=====여러가지 연산기의 간략한 구조===== | =====여러가지 연산기의 간략한 구조===== | ||
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* ASIC : FPGA 로 만든 명령어 세트를 고정시켜 대량 생산한 것, 멀티 코어 프로세서에서 병렬 게이트 어레이 기능. | * ASIC : FPGA 로 만든 명령어 세트를 고정시켜 대량 생산한 것, 멀티 코어 프로세서에서 병렬 게이트 어레이 기능. | ||
- | <WRAP centeralign box>{{ 음향: | + | <imgcaption image5 center|AMD ZEN Micro 아키텍쳐, |
- | AMD ZEN Micro 아키텍쳐, | + | >{{ 음향: |
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- | CPU와 GPU의 차이</WRAP> | + | |
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- | <WRAP centeralign box>{{ 음향: | + | <imgcaption image7 center|DSP와 FPGA의 차이>{{ 음향: |
- | DSP와 FPGA의 차이</WRAP> | + | |
=====DSP LoadLock===== | =====DSP LoadLock===== | ||
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UAD의 경우에는 설정에서 DSP 점유율이 어느 정도 이상이 되게 되면 더 이상 플러그인을 못걸게 Lock을 설정 가능하다. | UAD의 경우에는 설정에서 DSP 점유율이 어느 정도 이상이 되게 되면 더 이상 플러그인을 못걸게 Lock을 설정 가능하다. | ||
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